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https://hdl.handle.net/20.500.12008/21163
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Campo DC | Valor | Lengua/Idioma |
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dc.contributor.author | Barboni, Leonardo | es |
dc.contributor.author | Fiorelli, Rafaella | es |
dc.contributor.author | Silveira, Fernando | es |
dc.date.accessioned | 2019-07-03T16:35:48Z | - |
dc.date.available | 2019-07-03T16:35:48Z | - |
dc.date.issued | 2005 | es |
dc.date.submitted | 20190703 | es |
dc.identifier.citation | Barboni, L, Fiorelli, R, Silveira, F. Diseño de bloques de RF de bajo consumo en inversión débil y moderada [Preprint] Publicado en 11o. Workshop Iberchip, Bahía, Brasil, 2005. | es |
dc.identifier.uri | https://hdl.handle.net/20.500.12008/21163 | - |
dc.description | Trabajo presentado en el 11o. Workshop Iberchip, Bahía, Brasil, 2005 | es |
dc.description.abstract | En este trabajo se analiza el diseño de bloques de circuitos CMOS de radiofrecuencia en la banda ISM de 910MHz, operando en las regiones de inversión débil o moderada de polarización del transistor MOS. Se presenta una herramienta de diseño de amplificadores que muestra la existencia de un diseño óptimo de mínimo consumo para una ganancia especificada y muestra además la viabilidad de operar en inversión moderada aun para frecuencias de 910MHz con tecnología de 0.35um. Con esta herramienta es posible comparar los compromisos de ganancia y consumo de distintas tecnologías en el espacio de diseño dado por el plano ID-gm/ID. Se presentarán las formulaciones, discusiones de límite de frecuencias para el cual el modelo del MOSFET utilizado (ACM) es válido y comparaciones con simulaciones utilizando BSIM3v3 [1]. Se mostrarán la comparación de tecnologías de 0.8um y 0.35um y la implementación en 0.35um de un amplificador de 2 dBm de potencia de salida, ganancia 40 V/V y un consumo total de 5.5 mA. Asimismo se mostrará el flujo de diseño y resultado para un VCO operando a 910MHz. | es |
dc.language | es | es |
dc.rights | Las obras depositadas en el Repositorio se rigen por la Ordenanza de los Derechos de la Propiedad Intelectual de la Universidad De La República. (Res. Nº 91 de C.D.C. de 8/III/1994 – D.O. 7/IV/1994) y por la Ordenanza del Repositorio Abierto de la Universidad de la República (Res. Nº 16 de C.D.C. de 07/10/2014) | es |
dc.subject.other | ELECTRÓNICA | es |
dc.title | Diseño de bloques de RF de bajo consumo en inversión débil y moderada | es |
dc.type | Preprint | en |
dc.rights.licence | Licencia Creative Commons Atribución – No Comercial – Sin Derivadas (CC - By-NC-ND) | es |
Aparece en las colecciones: | Publicaciones académicas y científicas - Instituto de Ingeniería Eléctrica |
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